Η 台湾半導体製造有限会社。 で公式に発表 2022年TSMC技術シンポジウム、その製造技術 N2（カテゴリー2 nm）
O その最初のノード TSMC のカテゴリーで 2 nmの 電界効果トランジスタを使用します（GAAFET-ゲートオールアラウンド電界効果トランジスタ）そして新しい製造プロセスは性能と電力の利点を提供しますが、トランジスタ密度の点では、リリースされた2025年にはほとんど印象に残りません。
まったく新しいプロセステクノロジープラットフォームであるため、 TSMCのN2 XNUMXつの重要な革新をもたらします：ナノフォイルトランジスタ（これはTが呼ぶものですGAAFETとしてのSMC） と 裏側パワーレール ノードのワットあたりのパフォーマンス特性を向上させるという同じ目的を果たします。
ナノフォイルトランジスタ GAA 漏れを減らすために、XNUMXつの側面すべてでゲートで囲まれたチャネルがあります。 さらに、チャネルを広げてトラフィックフローを増やし、効率を高めたり、縮小して電力消費とコストを最小限に抑えることができます。
これらのナノフォイルトランジスタに十分な電力で電力を供給し、それらのいずれかを無駄にするために、 TSMCのN2 背面に電源を使用します。これは、バックエンドオブライン抵抗と戦うための最良のソリューションのXNUMXつと考えられています（BEOL 拡張).
確かに、エネルギー効率と消費の観点から、TSMCナノベースのN2ノードは達成することができます 10％から15％高い歩留まり 同じパワーと複雑さで、そして2エネルギー消費量を5％から30％削減 トランジスタと比較して同じ周波数と数のトランジスタで TSMC N3E。 ただし、新しいノードは、N1,1Eと比較してチップ密度を約3倍しか増加させません。
一般的に、 TSMCのN3 完全なノード効率の向上と消費電力の削減を提供します。 しかし、密度の点では、新しいテクノロジーはほとんど印象に残りません。 たとえば、ノード N3E TSMCの 1,3X N5と比較してチップ密度が増加します。これは大幅な増加です。
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